阻抗计算公式、polar si9000(教程)
阻抗計算公式、polar si9000(教程)
2015-10-29 22:16?2548人閱讀?評論(0)?收藏?舉報 給初學者的一直有很多人問我阻抗怎么計算的. 人家問多了,我想給大家整理個材料,于己于人都是個方便.如果大家還有什么問題或者文檔有什么錯誤,歡迎討論與指教!
在計算阻抗之前,我想很有必要理解這兒阻抗的意義。
傳輸線阻抗的由來以及意義
傳輸線阻抗是從電報方程推導出來(具體可以查詢微波理論)
如下圖,其為平行雙導線的分布參數等效電路:
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從此圖可以推導出電報方程
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取傳輸線上的電壓電流的正弦形式
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得
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推出通解
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定義出特性阻抗
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無耗線下r=0, g=0 得
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注意,此特性阻抗和波阻抗的概念上的差異(具體查看平面波的波阻抗定義)?
特性阻抗與波阻抗之間關系可從?此關系式推出.
Ok,理解特性阻抗理論上是怎么回事情,看看實際上的意義,當電壓電流在傳輸線傳播的時候,如果特性阻抗不一致所求出的電報方程的解不一致,就造成所謂的反射現象等等.在信號完整性領域里,比如反射,串擾,電源平面切割等問題都可以歸類為阻抗不連續問題,因此匹配的重要性在此展現出來.
疊層(stackup)的定義
我們來看如下一種stackup,主板常用的8 層板(4 層power/ground 以及4 層走線層,sggssggs,分別定義為L1, L2…L8)因此要計算的阻抗為L1,L4,L5,L8
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下面熟悉下在疊層里面的一些基本概念,和廠家打交道經常會使用的
Oz 的概念
Oz 本來是重量的單位Oz(盎司 )=28.3 g(克)
在疊層里面是這么定義的,在一平方英尺的面積上鋪一盎司的銅的厚度為1Oz,對應的單位如下
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?介電常數(DK)的概念
電容器極板間有電介質存在時的電容量Cx 與同樣形狀和尺寸的真空電容量Co之比為介電常數：
ε = Cx/Co = ε'-ε"
?Prepreg/Core 的概念
pp 是種介質材料,由玻璃纖維和環氧樹脂組成,core 其實也是pp 類型介質,只不過他兩面都覆有銅箔,而pp 沒有.
傳輸線特性阻抗的計算
首先,我們來看下傳輸線的基本類型,在計算阻抗的時候通常有如下類型: 微帶線和帶狀線,對于他們的區分,最簡單的理解是,微帶線只有1 個參考地,而帶狀線有2個參考地,如下圖所示
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對照上面常用的8 層主板,只有top 和bottom 走線層才是微帶線類型,其他的走線層都是帶狀線類型
在計算傳輸線特性阻抗的時候, 主板阻抗要求基本上是:單線阻抗要求55 或者60Ohm,差分線阻抗要求是70~110Ohm,厚度要求一般是1~2mm,根據板厚要求來分層得到各厚度高度.
在此假設板厚為1.6mm,也就是63mil 左右, 單端阻抗要求60Ohm,差分阻抗要求100Ohm,我們假設以如下的疊層來走線
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先來計算微帶線的特性阻抗,由于top 層和bottom 層對稱,只需要計算top 層阻抗就好的,采用polar si6000,對應的計算圖形如下:
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在計算的時候注意的是:
1,你所需要的是通過走線阻抗要求來計算出線寬W(目標)
2,各廠家的制程能力不一致,因此計算方法不一樣,需要和廠家進行確認
3,表層采用coated microstrip 計算的原因是,廠家會有覆綠漆,因而沒用surface microstrip 計算,但是也有廠家采用surface microstrip 來計算的,它是經過校準的
4,w1 和w2 不一樣的原因在于pcb 板制造過程中是從上到下而腐蝕,因此腐蝕出來有梯形的感覺(當然不完全是)
5,在此沒計算出精確的60Ohm 阻抗,原因是實際制程的時候廠家會稍微改變參數,沒必要那么精確,在1,2ohm 范圍之內我是覺得沒問題
6,h/t 參數對應你可以參照疊層來看
再計算出L5 的特性阻抗如下圖
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記得當初有各版本對于stripline 還有symmetrical stripline 的計算圖,實際上的差異從字面來理解就是symmetrical stripline 其實是offset stripline 的特例H1=H2
在計算差分阻抗的時候和上面計算類似,除所需要的通過走線阻抗要求來計算出線寬的目標除線寬還有線距,在此不列出
選用的圖是
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在計算差分阻抗注意的是:
1,在滿足DDR2 clock 85Ohm~1394 110Ohm 差分阻抗的同時又滿足其單端阻抗,因此我通常選擇的是先滿足差分阻抗(很多是電流模式取電壓的)再考慮單端阻抗(通常板廠是不考慮的,實際做很多板子,問題確實不算大,看樣子差分線還是走線同層同via 同間距要求一定要符合)
----------謹以此文懷念初學SI 的艱苦歲月
特性阻抗公式 (含微帶線,帶狀線的計算公式)
a.微帶線(microstrip)?
Z={87/[sqrt(Er+1.41)]}ln[5.98H/(0.8W+T)] 其中，W為線寬，T為走線的銅皮厚度，H為走線到參考平面的距離，Er是PCB板材質的介電常數(dielectric constant)。此公式必須在0.1<(W/H)<2.0及1<(Er)<15的情況才能應用。
b.帶狀線(stripline)?
Z=[60/sqrt(Er)]ln{4H/[0.67π(0.8W+T)]} 其中，H為兩參考平面的距離，并且走線位于兩參考平面的中間。此公式必須在W/H<0.35及T/H<0.25的情況才能應用
差分阻抗的計算方法及公式
?
The Differential Impedance Calculator is provided?free?to registered users.Please Register here
Instructions:
1. Select the number of substrate layers required.
2. You will then be presented with a table representing the suggested stack-up for that type of substrate.
3. Modify the variables to examine the effects on the trace Characteristic and Differential Impedance.
| Number of physical board layers | ||||
| 4 | 6 | 8 | 10 | 12 |
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Important:?The trace separation should not be adjusted to alter the Differential Impedance - trace separation should always be kept to the minimum clearance specified by the PCB vendor.
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Note:
1.??????All dimensions are in MIL (thousands of an inch).
2.??????The Dielectric Constant of FR4 material may vary by as much as 20% (4.2 to 5.2).
3.??????The overall Dielectric Thickness (Cu to Cu) should total 62 MIL nominally.
4.??????Variables unavailable for modification have no significant effect on the impedance of the traces.
5.??????The default multilayer board stack-ups are taken from Advance Design for SMT, Barry Olney/AMC.
6.??????The Impedance Calculator uses formulae derived from:
·????????IPC-D-317 - Design Standard for Electronic Packaging Utilizing High Speed Techniques.?
·????????EMC & the Printed Circuit Board - Montrose.
7.??????Only Edge Coupled Differential Pairs are considered. No allowance has been made for Broad Side Coupling from adjacent layers. It is good practice to route adjacent layers orthogonal to each other in order to reduce any coupling that may occur.
8.?? To reduce EMI, high frequency, fast rise time signals should be routed between the reference planes.
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All care has been taken to ensure that the results are correct but no responsibility is taken for any errors.
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If you prefer to do the calculations yourself - please use the formulae below.
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| Zo =? [80/Sqrt Er]* ln(1.9(2H+T)/(0.8W+T)) * (1 - (H?/ 4(H?+?C?+ T))) Zdiff = 2*Zo (1 – 0.347 e-2.9D/B)? |
?
where
W = trace width
T = trace thickness
H = distance to nearest reference plane
Er = dielectric constant
D = trace edge to edge spacing
C?=?signal layer?separation
B?=?reference plane?separation
?
| 4.7 |
| 2.2 |
| 2.5 |
| 3.5 |
| 4.2 |
Relative Dielectric Constants of substrate materials
PCB阻抗設計詳解
?? 1、前言
隨著科技發展, 尤其在積體電路的材料之進步，使運算速度有顯著提升, 促使積體電路走向高密度﹑小體積, 單一零件, 這些都導致今日及未來的印刷電路板走向高頻響應, 高速率數位電路之運用, 也就是必須控制線路的阻抗﹑低失真﹑低干擾及低串音及消除電磁干擾EMI。阻抗設計在PCB設計中顯得越來越重要。作為PCB制造前端的制前部，負責阻抗的模擬計算，阻抗條的設計。客戶對阻抗控制要求越來越嚴，而阻抗管控數目也原來越多，如何快速，準確地進行阻抗設計，是制前人員非常關注的一個問題。?
2、阻抗主要類型及影響因素
阻抗（Zo）定義：對流經其中已知頻率之交流電流所產生的總阻力稱為阻抗（Zo）。對印刷電路板而言，是指在高頻訊號之下，某一線路層(signal layer)對其最接近的相關層(reference plane)總合之阻抗。
2.1 阻抗類型：
(1)特性阻抗 在計算機﹑無線通信等電子信息產品中, PCB的線路中的傳輸的能量, 是一種由電壓與時間所構成的方形波信號（square wave signal, 稱為脈沖pulse），它所遭遇的阻力則稱為特性阻抗。
(2)差動阻抗 驅動端輸入極性相反的兩個同樣信號波形，分別由兩根差動線傳送,在接收端這兩個差動信號相減。差動阻抗就是兩線之間的阻抗Zdiff。
(3)奇模阻抗 兩線中一線對地的阻抗Zoo，兩線阻抗值是一致。
(4)偶模阻抗 驅動端輸入極性相同的兩個同樣信號波形, 將兩線連在一起時的阻抗Zcom。
(5)共模阻抗 兩線中一線對地的阻抗Zoe，兩線阻抗值是一致,通常比奇模阻抗大。
其中特性和差動為常見阻抗，共模與奇模等很少見。
2.2 影響阻抗的因素：
W-----線寬/線間 線寬增加阻抗變小，距離增大阻抗增大；?
H----絕緣厚度 厚度增加阻抗增大；
T------銅厚 銅厚增加阻抗變小；?
H1---綠油厚 厚度增加阻抗變小；
Er-----介電常數 參考層 DK值增大, 阻抗減小；?
Undercut----W1-W undercut增加, 阻抗變大。
3、阻抗計算自動化
如今，我們業界最常用的阻抗計算工具是Polar公司提供的Si8000 Field Solver，Si8000是全新的邊界元素法場效解計算器軟件，建立在我們熟悉的早期Polar阻抗設計系統易于使用的用戶界面之上。此軟件包含各種阻抗模塊，人員通過選擇特定模塊，輸入線寬，線距，介層厚度，銅厚，Er值等相關數據，可以算出阻抗結果。一個PCB阻抗管控數目少則4，5組，多則幾十組，每一組的管控線寬，介層厚度，銅厚等都不同，如果一個個去查數據，然后手動輸入相關參數計算，非常費時且容易出錯。
下面，將介紹如何通過業界領先的制前設計工程軟件解決方案供貨商奧寶科技的InPlan軟件，自動地進行阻抗設計，大幅提高制前工作效率。
奧寶科技的InPlan系統，可與Si8000連接，在以下數據庫建立的基礎上，自動計算阻抗：首先，在InPlan建立完整的物料庫，按不同廠商，型號歸類。建入依廠內實際制程參數得出的壓合厚度，基板銅厚，PP含膠量等數據。
然后，在InPlan里建立算阻抗的規則Rule，如綠油厚度，Undercut值也可根據不同的銅厚，阻抗模塊或內外層的不同設定規則。介電常數則主要根據材料種類，阻抗模塊的不同分別寫入公式。阻抗值，阻抗線寬公差也通過InPlan Rule寫入規則。算阻抗時，InPlan根據規則自動帶出相關的阻抗影響參數值，算出最優化的阻抗結果。且不管有多少組阻抗，只需點一個按鈕，幾秒鐘的時間就可以得出所有結果。
4、自動生成阻抗條
如果客戶沒有自己設計阻抗條, 我們就需要自行設計阻抗條放于板邊或者折斷邊上(一般情況下阻抗條放于折斷邊需要客戶的同意)。電路板制造商在電路板邊設計滿足客戶阻抗控制所有特征及參數的阻抗條,通過測試阻抗條的阻抗值，反映出電路板達到客戶阻抗控制要求。要正確測試板內阻抗值，關鍵在于阻抗條的設計。
一般PCB廠阻抗條設計方式為:MI工程師根據算出的阻抗結果填寫阻抗附件表格，如阻抗值，參考層，管控線寬，測試孔，參考層屬性（正負片）等。
然后，CAM工程師根據MI提供的阻抗表格，手動制作阻抗條，或通過Script，輸入相關阻抗數據，用程式跑阻抗條。一般情況下, 一種阻抗值我們就設計一個阻抗條，制作一個阻抗條，一般都需10來分鐘，重復的手動數據填寫，非常費時，且容易出錯。
我們可通過奧寶的InCoupon 功能，將阻抗條的相關規則建入系統，可自動產生高品質阻抗條，直接導入Genesis系統。InCoupon 采用嵌入式發展架構，在半成品層級時即能偵測出層板間最理想的鉆孔位置，使現有板層的鉆孔作業可與 Coupon 線路層之間完全吻合，整合了完整的 CAM 與工程技術，產生出阻抗量測用的Coupon線路、發展架構與半成品表，并且可對Coupon 層級找出最理想的相互連接能力，以智慧型操作精靈取代復雜、手動計算，可在數秒間自動運算出可靠的量測線路Coupon，讓Coupon 的設計變成一項簡單且標準的工作。
5、總結
PCB的競爭越來越激烈，樣品交期越來越短，阻抗設計在制前工作中占了很大的比例，如何縮短阻抗制作時間，做出滿足客戶要求的阻抗匹配，是制前部必需考慮的一個問題。InPlan和InCoupon的出現，給阻抗設計提供了很好的幫助。當然，各PCB板廠自己的阻抗計算規則，Layout方式與大小都會不一樣，InPlan系統需專人進行開發，維護，才能真正實現其功能。但相信，阻抗設計的自動化，將在PCB制前部越來越普及
總結
以上是生活随笔為你收集整理的阻抗计算公式、polar si9000(教程)的全部內容，希望文章能夠幫你解決所遇到的問題。
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