IC設(shè)計(jì)中時(shí)鐘偏斜對延時(shí)的影響

1. 什么是時(shí)鐘偏斜

芯片實(shí)際工作中，時(shí)鐘并不是同時(shí)到達(dá)各個(gè)時(shí)序元件，在到達(dá)時(shí)間上又某種不確定性，因而可能減少用于計(jì)算的時(shí)間。
如下圖所示：圖中加粗clk線表示時(shí)鐘可能最遲到達(dá)的時(shí)間。斜陰影線(hashed line)表示由于時(shí)鐘偏斜，時(shí)鐘可能提早達(dá)到的時(shí)間范圍。

2.時(shí)鐘偏斜對延時(shí)的影響

在以觸發(fā)器為基礎(chǔ)的系統(tǒng)中對于最大延時(shí)約束，最壞情形發(fā)生在發(fā)送觸發(fā)器接收的是最遲到達(dá)的時(shí)鐘(上升沿)，而接收觸發(fā)器接收到的是最早到達(dá)的下一個(gè)時(shí)鐘(上升沿)。在這種情形中，時(shí)鐘偏斜將作為時(shí)序開銷從可以用于計(jì)算的時(shí)間中減去。對于最小延時(shí)約束，最壞情形發(fā)生在發(fā)送觸發(fā)器接收到的是早到達(dá)的時(shí)鐘(上升沿)，而接收觸發(fā)器接收的是遲到達(dá)的時(shí)鐘，在這種情形中，時(shí)鐘偏斜實(shí)際上相當(dāng)于增加了系統(tǒng)的保持時(shí)間。如上圖所示：

總結(jié)

以上是生活随笔為你收集整理的IC设计中时钟偏斜对延时的影响的全部內(nèi)容，希望文章能夠幫你解決所遇到的問題。

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