FPGA 之 SOPC 系列（九）SOPC 補充：altera與xilinx對比

今天給大俠帶來今天帶來FPGA 之 SOPC 系列第九篇，同時也是最后一篇，SOPC 補充：altera與xilinx對比，希望對各位大俠的學習有參考價值，話不多說，上貨。

本篇主要對altera和xilinx開發做了個總結，同時對SOPC做了簡單的開發流程對比，可以幫助在掌握altera的SOPC開發的基礎很快的學習xilinx的SOPC開發。

以下為本篇的目錄簡介：

• 9.1 開發工具對比

• 9.2 開發流程對比

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9.1 開發工具對比

• Altera 的開發工具有Quartus II 、Sopc builder、Nios II、signal tap II、DSP Builder；

• Xilinx 的開發工具有ISE、EDK、SDK、ChipScope 、System Generator；

Quartus II 相對于ISE，都是邏輯設計軟件，功能相當；

Sopc builder 相對于EDK，用來建立軟核，Sopc builder 是生成bsf 文件與quartus 接口，生成ptf 文件與nios 接口，而edk 則可直接生成目標文件（bit），而且還可以用EDK 進行軟件設計，也就是說EDK 可以不依賴ISE 和SDK 就可獨立完成一個設計。相比之下EDK 要勝sopc builder 一籌。

Nios II 相對于SDK，兩者功能相當，而且界面相似度達到99％。用SDK 進行軟件開發比

在EDK 中還是要好一些，界面比EDK 中的友好。

signal tap II 相對于ChipScope，嵌入式邏輯分析儀，方便調試；DSP Builder 相對于SystemGenerator 用來建立DSP 的算法模塊。

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9.2 開發流程對比

ALTERA 的SOPC 開發流程：

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硬件設計

首先，通過QUARTUS II 建立工程，新建一個Block Diagram/Schematic File 文件；

再打開SOPC Builder 建立CPU 系統，添加IP，點擊Genenater 生成.bsf 和.ptf 目標文件；再回到QUARTUS II，將bsf 文件導到入Schematic 中，分配引腳，編譯生成sof 和pof 文件。硬件設計算是完成。

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軟件設計

打開nios II,新建工程，select target hardware 為前面生成的pft 文件，建立軟件程序，編譯生成elf 文件。

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下載調試

先通過JTAG 接口下載sof 文件（硬件），再下載elf 文件查運行或debug。

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固化

通過AS 接口下載POF 文件，再通過JTAG 下載ELF 文件。

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硬件設計

打開EDK，建立CPU 系統，添加IP，點擊update bitstream，生成硬件bit 流文件。

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軟件設計

方式一、在EDK 里添加C 代碼，將軟件與硬件合成一個bit 文件，這樣程序在片內運行，適合于比較小的程序。

方式二、在EDK 里添加C 代碼，硬件生成bit 文件，軟件生成elf 文件，bit 下載到片內，elf 下載到片外。

方式三、在SDK 里進行軟件設計，同樣生成elf 文件，界面比edk 的要友好。

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下載調試與固化

如果軟件與硬件合成了一個bit 文件，則只需要下載和固化mcs(bit 轉化而來)文件了。如果軟件比較大，則需要分兩次下載，bit 下載到片內，elf 下載到片外，若要固化到flash 里，則還需要在edk 里添加bootloader 代碼，將其與硬件合成一個bit 文件。再將bit 轉化為mcs后固化到FPGA 配置芯片里，elf 文件下載到片外flash 里。

從開發流程來看， EDK 可以不依賴ISE 就能完成SOPC 的設計，當然它也可以像altera 那樣，將cpu 軟核導入到ise 中去。由此看來，xilinx 的開發流程更加的靈活，相比altera 要強大。

FPGA 之 SOPC 系列第九篇就到這里結束，本系列也更新到此，后續有時間再給各位大俠繼續更新相關內容，祝各位大俠一切安好，有緣再見！

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完

后續會持續更新，帶來Vivado、 ISE、Quartus II 、candence等安裝相關設計教程，學習資源、項目資源、好文推薦等，希望大俠持續關注。

江湖偌大，繼續闖蕩，愿大俠一切安好，有緣再見！

總結

以上是生活随笔為你收集整理的FPGA 之 SOPC 系列（九）SOPC 补充：altera与xilinx对比的全部內容，希望文章能夠幫你解決所遇到的問題。

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