VHDL程序結構

--設計庫和程序包調用 library IEEE; use IEEE.STD_LOGIC_1164.ALL; --電路端口說明和定義-VHDL實體描述部分 entity MUX41A is -- Port ( );PORT(a,b,c,d : IN STD_LOGIC;s0,s1 : IN STD_LOGIC;y : OUT STD_LOGIC ); end MUX41A; --結構體說明部分 architecture Behavioral of MUX41A isSIGNAL S : STD_LOGIC_VECTOR(1 DOWNTO 0); --電路模塊功能描述 beginS <= s1 & s0;PROCESS(s1,s0,a,b,c,d)--敏感信號表中也可以直接放S BEGIN CASE(S)

總結

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