案例分析一：假定CPU的主頻是500MHz。硬盤(pán)采用DMA方式進(jìn)行數(shù)據(jù)傳送，其數(shù)據(jù)傳輸率為4MB/s, 每次DMA傳輸?shù)臄?shù)據(jù)量為8KB, 要求沒(méi)有任何數(shù)據(jù)傳輸被錯(cuò)過(guò)。

如果CPU在DMA初始化設(shè)置和啟動(dòng)硬盤(pán)操作等方面用了1000個(gè)時(shí)鐘周期，并且在DMA傳送完成后的中斷處理需要500個(gè)時(shí)鐘，則在硬盤(pán)100%處于工作狀態(tài)的情況下， CPU用于硬盤(pán)I/O操作的時(shí)間百分比大約是多少？

案例分析二：

請(qǐng)求分頁(yè)管理系統(tǒng)中，假設(shè)某進(jìn)程的頁(yè)表內(nèi)容如下表所示。頁(yè)號(hào)頁(yè)框(Page Frame)號(hào)有效位(存在位)

0—0

1906H1

2—0

3235H1

4—0

頁(yè)面大小為4KB，一次內(nèi)存的訪問(wèn)時(shí)間是200ns，一次快表(TLB)的訪問(wèn)時(shí)間是2ns，處理一次缺頁(yè)的平均時(shí)間為107ns(已含更新TLB和頁(yè)表的時(shí)間)，進(jìn)程的駐留集大小固定為2，采用最近最少使用置換算法(LRU)和局部淘汰策略。

假設(shè)①TLB初始為空；②地址轉(zhuǎn)換時(shí)先訪問(wèn)TLB，若TLB未命中，再訪問(wèn)頁(yè)表(忽略訪問(wèn)頁(yè)表之后的TLB更新時(shí)間)；③有效位為0表示頁(yè)面不在內(nèi)存，產(chǎn)生缺頁(yè)中斷，缺頁(yè)中斷處理后，返回到產(chǎn)生缺頁(yè)中斷的指令處重新執(zhí)行。設(shè)有虛地址訪問(wèn)序列31A2H、24C2H、36B4H，

請(qǐng)問(wèn)：

(1)?依次訪問(wèn)上述三個(gè)虛地址，各需多少時(shí)間？給出計(jì)算過(guò)程。

(2)基于上述訪問(wèn)序列，虛地址24C2H的物理地址是多少？請(qǐng)說(shuō)明理由。

總結(jié)

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