32. DDR2内存内部结构-1
生活随笔
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32. DDR2内存内部结构-1
小編覺得挺不錯的,現在分享給大家,幫大家做個參考.
現在進入動態時序階段
一般,把對SDRAM的一次操作分為四個階段,命令階段/Bank操作階段,Device操作階段,數據總線階段。
命令階段:DMC要做兩件事情,1>把各路的控制信號線線置位成它該有的電平,如CLK/CAS/RAS等,同時把行地址線上ADDR0~ADDR14把行地址給出來。同時給出Bank0~2的地址,選擇8個bnak。控制器給出行地址以后,Device收到信號后進行解碼。首先對命令進行解碼,同時對address解碼,收到寄存器里面,分到行地址1分舵的多路器,分到各個bank進行解碼。Bank選通,選通以后,對整個一行進行解碼。
一個bank包含若干array(比如8個)
第二階段:Bank內進行處理的過程。讀數據的讀取/輸入。行地址打開以后,bank把這一行全部打開并把它放到bit line的地址線上,sensor部分可以對行地址進行讀取,
四塊bank共享一個通道,列地址選通后,并不是所有的bank都可以輸出寄存器。通過bank地址/列地址選擇哪一列進入register,只有1個字節能進入rigister。8個bit能進入。
第三步:device utilization,多個bank共享一
總結
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