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编程问答

南京邮电大学电工电子(数电)实验报告——数字电路与模拟电路的综合应用

發布時間:2024/3/26 编程问答 51 豆豆
生活随笔 收集整理的這篇文章主要介紹了 南京邮电大学电工电子(数电)实验报告——数字电路与模拟电路的综合应用 小編覺得挺不錯的,現在分享給大家,幫大家做個參考.

文章目錄

  • 數字電路與模擬電路的綜合應用
    • (1)實驗目的
    • (2)實驗原理或設計過程
    • (3)RTL代碼設計(加分項)
    • (4)實驗電路圖
    • (5)實驗數據分析和實驗結果
    • (6)附錄:示波器圖像

數字電路與模擬電路的綜合應用

(1)實驗目的

1、了解D/A轉換器的基本工作原理和基本結構
2、了解大規模集成D/A轉換器的功能及其典型應用方法
3、掌握綜合性電路的調測方法

(2)實驗原理或設計過程

實驗內容∶設計一個可編程波形發生器技術指標∶
① 輸出信號波形受K2和K1控制
開關K2K1=01時,輸出信號波形為正斜率鋸齒波。開關K2K1=10時,輸出信號波形為負斜率鋸齒波。
開關K2K1=11時,輸出信號波形為正負斜率鋸齒波組成的三角波。
② 輸出信號頻率
輸出鋸齒波時/=1KHZ;輸出三角波時/,=0.5KHZ。
③ 輸出正負斜率鋸齒波上升或下降的臺階數等于16個。
④ 輸出幅度V在0V~2V間可調。

設計條件∶
① 電源電壓為±5V。
②系統時鐘信號可以自行設計,也可以采用實驗箱所提供的信號源。
波形控制電路∶
K2K1=01時,轉換器輸入的二進制數為加法計數;
K2K1=10時,轉換器輸入的二進制數為減法計數;
K2K1=11時,轉換器先輸入加法計數結果,然后輸入減法計數結果。

(1)原理圖實現數字電路部分:

邏輯電路卡諾圖:

(3)RTL代碼設計(加分項)

  • RTL代碼
module DAC #( parameter M=4) (K,clk,rst_n,cnt,co);input [1:0]K;input clk;input rst_n;output reg[M-1:0]cnt;output reg co;always @(posedge clk,negedge rst_n)if(!rst_n)begincnt<=0;co<=1'b0;endelse begincase(K)2'b01:beginif(cnt==4'b1111)cnt<=5'b0000;elsecnt<=cnt+1'b1;end2'b10:begincnt<=4'b1111;if(cnt==4'b0000)cnt<=4'b1111;elsecnt<=cnt-1'b1;end2'b11:beginif(co==0)beginif(cnt==4'b1111)begin cnt<=cnt;co<=1;endelse cnt<=cnt+1'b1;endif(co==1)beginif(cnt==4'b0000)begin cnt<=cnt;co<=0;endelse cnt<=cnt-1'b1;endend endcase end endmodule
  • 仿真測試模塊代碼
`timescale 1ns / 1ps module DAC_tb;reg [1:0] K;reg clk;reg rst_n;wire [3:0] cnt;wire co;DAC uut (.K(K), .clk(clk), .rst_n(rst_n), .cnt(cnt), .co(co));initial beginK = 0;clk = 0;rst_n = 0;#100;rst_n=1;K=2'b01;#400;K=2'b10;#400;K=2'b11;#400;endalways #7 clk=~clk;endmodule

(4)實驗電路圖

(5)實驗數據分析和實驗結果

當K1K2=01時,計數器遞增。

當K1K2=10時,計數器遞減。

當K1K2=11時,計數器先增后減。

可編程波形發生器的波形圖:

(6)附錄:示波器圖像

當K1K2=01時,計數器遞增。

當K1K2=10時,計數器遞減。

當K1K2=11時,計數器先增后減。

總結

以上是生活随笔為你收集整理的南京邮电大学电工电子(数电)实验报告——数字电路与模拟电路的综合应用的全部內容,希望文章能夠幫你解決所遇到的問題。

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