上一文只是說(shuō)了約束的具體內(nèi)容. 完成整個(gè)綜合的腳本還沒有寫. 本文將介紹這個(gè).

我們這個(gè)實(shí)現(xiàn)是 讀入design.v ，完成creat_clock、設(shè)置好約束，然后保存。并不進(jìn)行綜合。

?

我們先編寫了setup文件，配置了target_librart、link、search_path、

接著啟動(dòng)dc，然后我們讀入 verilog、然后設(shè)置current_design、check_design

其中my.con 內(nèi)容如下:

?

?在運(yùn)行之前,我們可以使用dcprochek ?（shell命令）進(jìn)行檢查 ?my.con、my_design.scr的語(yǔ)法。

?

?

?

check_timing 命令，會(huì)檢查約束時(shí)候有遺漏的部分。也挺重要的，我們這個(gè)地方?jīng)]有加。

??

這個(gè)結(jié)果時(shí)進(jìn)行 check_timg報(bào)出來(lái)的，因?yàn)槲仪那牡淖⑨尩袅薿ut1的約束信息,它能報(bào)出來(lái)提示我們 還沒有約束endpoint

?

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總結(jié)

以上是生活随笔為你收集整理的DC guide ---8的全部?jī)?nèi)容，希望文章能夠幫你解決所遇到的問題。

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