本系列文章將向大家推薦一個學習 Verilog 的好去處：HDLBits.
HDLBits 在提供 Verilog 基礎語法教程的同時，還能夠在線仿真你的 Verilog 模塊，將你的輸出與正確的時序比較，可以說真的是很棒了。Wire - HDLBitshdlbits.01xz.net

首先送上傳送門。

作者今天被安利了一個很棒的 Verilog 學習網站：HDLBits 。然后發現知乎上還沒有與 HDLBits 相關的話題，便寫下這篇文章向大家推薦。

Verilog 基礎教程

HDLBits 有一系列的 Verilog 基礎知識，從最簡單的 wire 的概念開始，包括了 Verilog 的基礎語法，由邏輯門與觸發器組成的電路，組合時序電路的概念，模塊層級概念，testbench 的編寫等等。

層級目錄

完整地對 Verilog 的語法進行整理就已經很棒了，我一直沒有發現這樣系統整理 Verilog 語法的中文網站，比如像菜鳥教程這樣的網站，提供了大量軟件語言的語法學習與備忘查詢，大多數語言還支持在線編譯執行。

當然，Verilog 語法不是最重要的事

Verilog 在線仿真

HDLBits 還提供了類似上圖中，在線執行 c 語言代碼的功能，可以在線對 Verilog 代碼進行仿真，觀察輸出的時序。

比如在 Wire 的教程中，就需要你實現一個模塊，實現 wire 連線的功能。

假如非常睿智，寫錯成 assign out = ~ in; 那么提交之后，網站會指出你的時序同正確時序的差異：

每個知識條目下，基本都有相應的練習，比如這個計數器。

如果你突然發現自己有點不確定怎么實現這個計數器了，那趕緊上 HDLBits 操練下吧。

Wire - HDLBitshdlbits.01xz.net

另外，簡單注冊之后，你的程序和進度就可以保存了。

作者也是剛剛接觸這個網站，如果這個網站足夠有趣的話，似乎又可以開始一個系列文章來一起探索一下 HDLBits

原文作者：ljgibbs

總結

以上是生活随笔為你收集整理的verilog 计数器_HDLBits: 在线学习 Verilog （）的全部內容，希望文章能夠幫你解決所遇到的問題。

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