標題不能太長，只能貼一部分信息，但是不影響大家百度，現在所有報錯信息貼出來：

61031145 ERROR - Cannot place PIO comp "MDP_IN_HS" on PIO site "F5/PB6C" (I/O bank 2).

61031260 ERROR - Cannot place PIO comp "MDP_IN_HS" on the proposed PIO site "PB6C / F5" because the types of their IOLOGICs are incompatible: the associated IOLOGIC comp "MDP_IN_HS_MGIOL" has been set to "IDDR4" mode (of type "BIOLOGIC"), while the IOLOGIC site is of type "BSIOLOGIC".

61031147 ERROR - Please check the pin locking in your preference file.

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這個報錯其實是接著上一篇文章的，上一篇文章沒有講完

先介紹下情況：客戶用的是LCMXO3L-1300E-5UWG36CTR,調用了ddr_generic,而且是GDDRX4_RX.ECLK ，

然后客戶綁定管腳：F5

PAR之后就報錯了，錯誤提示很模糊---但是可以從UG找到答案。

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?上圖告訴我們GDDRX4—RX.ECLK，必須要使用A/B差分對，然后我們檢查F5是不是A/B PAIR

F5不是A/B pair而是C/D PAIR,所以自然報錯，因為A/B pair 可以跑到450MHZ,但是C/D PAIR跑不到450MHZ,也就是C/D PAIR最多也就是只能X2

假如要跑到，450MHZ解決的辦法就是將信號綁到A/B pair上。

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這個故事也告訴我們，在評估高速接口，在畫原理圖之前最好是把要用到的腳先PAR一遍，特別是又不懂哪個手冊哪個章節說了這些限制規則的同志們

還有就是再次驗證了一點，問題十有八九都是客戶不按照要求搞出來的，建議要用這個IP就先看這個IP的手冊。

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轉載于:https://www.cnblogs.com/xiaozhuge/p/6626352.html

總結

以上是生活随笔為你收集整理的Cannot place PIO comp S on the proposed PIO site PB6C / F5 because the types of their IOLOGICs a...的全部內容，希望文章能夠幫你解決所遇到的問題。

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