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嵌入式系统降低功耗的设计技术

發(fā)布時間:2023/11/27 45 豆豆
生活随笔 收集整理的這篇文章主要介紹了 嵌入式系统降低功耗的设计技术 小編覺得挺不錯的,現(xiàn)在分享給大家,幫大家做個參考.

電源通常被認為是整個嵌入式系統(tǒng)的“心臟”,絕大多數(shù)電子設(shè)備50%~80%的節(jié)能潛力在于電源系統(tǒng)。研制開發(fā)新型開關(guān)電源是節(jié)能的主要舉措之一。 近年來許多公司相繼推出一系列功能齊全、種類繁多的低功耗器件,具有種類更多、功耗更低、體積更小、使用方便等特點。

電路的設(shè)計與元件的選取是同時或交叉進行的。在功能要求相同的情況下,不同的人可以設(shè)計出不同的電路,雖然功能可以相同,但電路功耗卻往往相距甚大。電路設(shè)計和元件選取考慮的因素很多,對其中需要注意的地方進行介紹。

1、采用低功耗器件

幾乎所有的TTL工藝的邏輯電路、單片機、存儲器以及外圍電路都有相應(yīng)CMOS工藝的低功耗器件,采用這些器件是降低系統(tǒng)功耗最直接的方法。

2、采用高度集成專用器件

例如用單片機設(shè)計一個電子體溫計,就沒有必要采用80C51 單片機,而應(yīng)該采用Epson、Holtek等生產(chǎn)的專用于測量體溫的單片機,其內(nèi)部集成了測量體溫所需要的ADC、振蕩器、電壓基準、LED顯示驅(qū)動等部件,電路只需幾個電阻電容元件整個電路可在1.2~1.5V電壓下工作,功耗極低,而且可靠性、體積等都比用分離器件設(shè)計更好。DC/DC變換器在市場上有各種各樣的模塊供選擇,而且效率高、功耗低、體積小、可靠性高,完全沒必要采用分離電路搭接。

3、動態(tài)調(diào)整處理器的時鐘頻率和電壓

在系統(tǒng)指標允許的情況下,盡量使用低頻率器件有助于降低系統(tǒng)功耗。處理器根據(jù)當(dāng)前的工作負載,運行在不同的性能等級上。例如,一個MPEG視頻播放器需要的處理器性能比MP3音頻播放器高一個數(shù)量級。因此,當(dāng)播放MP3時,處理器可以運行在較低頻率上,而仍然能保證播放的高質(zhì)量。當(dāng)時鐘頻率降低時,可以同時降低處理器的供電電壓,以達到節(jié)能的目的。

動態(tài)電壓調(diào)整技術(shù)(DVS)就利用了CMOS工藝處理器的峰值頻率與供電電壓成正比這一特點。減少供電電壓并同時降低處理器的時鐘速度,功耗將會呈二次方的速度下降,代價是增加了運行時間。

4、利用“節(jié)電”工作方式

許多器件都有低功耗的“節(jié)電”方式,如微處理器的閑置、掉電工作方式,存儲器的維持工作、ADC和DAC的節(jié)能工作方式等,因此設(shè)計時充分利用其“節(jié)電”方式為達到節(jié)電的效果。

另外,合理處理器件的空余引腳也是非常重要的。大多數(shù)數(shù)字電路的輸出端在輸出低電平時,其功耗遠大于輸出高電平時的功耗,設(shè)計時應(yīng)注意控制低電平的輸出時間,閑置時使其處于高電平輸出狀態(tài)。因此,多余的非門、與非門的輸入端應(yīng)接低電平,多余的與門、或門的輸入端應(yīng)接高電平。對ROM或RAM及其他有片選信號的器件,不要將“片選”引腳直接接地,避免器件長期被接通,而應(yīng)與“讀/寫”信號結(jié)合,只對其進行讀或?qū)懖僮鲿r才選通器件。

5、實行電源管理

目前大部分的傳感器、接口器件、顯示器件等本身還沒有低功耗工作模式,而有些便攜式儀器又不可避免地要使用它們,這些器件往往成了電路中的“耗電大戶”。這種情況下,可對電路進行模塊設(shè)計,工作時對大功耗模塊實施間斷供電,即設(shè)置電源形狀電路,并通過軟件或定時電路控制開關(guān),使大功耗模塊電路僅在需要工作的短時間內(nèi)加電,其余時間則處于斷電狀態(tài)。

現(xiàn)在便攜式電子產(chǎn)品對供電電路的要求越來越復(fù)雜,不僅要求電源本身穩(wěn)定,而且還要求有電壓監(jiān)測、電源管理功能,還要滿足小型化、延長電池壽命等要求。便攜式產(chǎn)品設(shè)備由于受尺寸、成本的限制,往往在著手設(shè)計供電電路之前就已經(jīng)確定了電池的數(shù)量和種類。電池數(shù)量限制了電源的電壓范圍,直接影響電源管理電路的成本和復(fù)雜程度。對于電池節(jié)數(shù)多的系統(tǒng)可選用線性穩(wěn)壓器,電路設(shè)計簡單、成本低,但轉(zhuǎn)換效率相對較低;對于電池節(jié)數(shù)少的系統(tǒng)則須選用成本較高的開關(guān)電源,電路設(shè)計復(fù)雜,但由于減少了電池數(shù)量,電源成本可降低。

由于便攜式嵌入式系統(tǒng)的設(shè)計需要考慮尺寸、重量、成本、電池種類、轉(zhuǎn)換效率(電池工作時)等諸多因素,不同產(chǎn)品對以上指標的要求會有不同的側(cè)重。例如,只是偶爾處于工作狀態(tài)的產(chǎn)品較注重電源在空載時的靜態(tài)電流,并不十分注重滿荷下電源的工作效率;蜂窩電話則注重電源所能提供的峰值電流和轉(zhuǎn)換效率。因此,很難研制出一種電源芯片適應(yīng)所有產(chǎn)品的需求,嵌入式系統(tǒng)的多樣化導(dǎo)致了電源芯片的多樣化。

拓展學(xué)習(xí):STM32低功耗模式下GPIO如何配置最節(jié)能?

總結(jié)

以上是生活随笔為你收集整理的嵌入式系统降低功耗的设计技术的全部內(nèi)容,希望文章能夠幫你解決所遇到的問題。

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