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编程问答

testbench实例 vhdl_学写 Testbench --- 结构篇VHDL实例

發布時間:2023/12/10 编程问答 36 豆豆
生活随笔 收集整理的這篇文章主要介紹了 testbench实例 vhdl_学写 Testbench --- 结构篇VHDL实例 小編覺得挺不錯的,現在分享給大家,幫大家做個參考.

testbench.v:

----------------------------------------------------------------------

//

// File header 具體參考 編碼風格專題

//

`define MAX 20 宏定義

`include "driver.v"

`include "monitor.v包含有其他模塊,如果在同一目錄下可以不指定include

`timescale 1n/10p指定仿真精度

module tb; 定義模塊名為tb

reg a;

reg b;

reg ci

wire sum;

wire cout;申明線型與寄存器型

parameter LENGTH = 20;參數化一些值

adder adder(.a(a),

.b(b),

.ci(ci),

.sum(sum),

.cout(cout)

);

driver driver();

monitor monitor();實例化DUT,以及一些驅動和監測

`include "task.v"包含task.v文件

initial

begin

add_test;

#MAX $finish;

endStimulus,調用了task.v里的add_test

`undef MAX由于宏是全局的,防止有沖突發生,最后要undef

endmodule模塊結束

總結

以上是生活随笔為你收集整理的testbench实例 vhdl_学写 Testbench --- 结构篇VHDL实例的全部內容,希望文章能夠幫你解決所遇到的問題。

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