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verilog入门笔记

發布時間:2024/2/28 42 豆豆
生活随笔 收集整理的這篇文章主要介紹了 verilog入门笔记 小編覺得挺不錯的,現在分享給大家,幫大家做個參考.

教材:ModelSim電子系統分析及仿真

把設計當成黑盒子/白盒子

把mux當做一個黑盒子,稱為行為級(系統級)描述

寄存器傳輸級(從語法角度的說法)

門級描述:直接描述mux的內部關系,里面有哪些門(部件),不把mux當做一個黑盒子

一個加法器的實現
行為描述↓

一個比較器的實現
行為描述↓

一個多路選擇器

module mux(out, in0, in1, sel)parameter N=8;output[n:1] out;input[n:1] in0,in1;input sel;assign out=sel?in1:in0; endmodule









verilog中monitor怎么理解?

這是仿真命令,監控你需要的變量

格式:$monitor($time,,"要顯示的東西",對應的變量)
比如:$monitor($time,,"r = %b,p = %d",r,p)
那么在modelsim的控制臺上就會顯示出引號中的東西

$display用法類似,$monitor(r = %b,p = %d",r,p)


測試平臺的編寫

總結

以上是生活随笔為你收集整理的verilog入门笔记的全部內容,希望文章能夠幫你解決所遇到的問題。

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