vivado實(shí)現(xiàn)基本D觸發(fā)器

基本D觸發(fā)器功能

一個(gè)基本的 D 觸發(fā)器的工作原理為：當(dāng)時(shí)鐘信號(hào)的上升沿到來(lái)時(shí)，輸入端口 D 的數(shù)據(jù)將傳遞給輸出端口 Q 和輸出端口 Q。在此，輸出端口 Q 和輸出端口 Q 除了反相之外，其他特性都是相同的。

Verilog代碼實(shí)現(xiàn)

module async_rddf(clk, d,q,qb); input clk, d; output q,qb; reg q,qb; always @(posedge clk) beginq<=d;qb<=~d;end endmodule

總結(jié)

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