本文使用FPGA實(shí)現(xiàn)跳舞機(jī)。使用verilog語(yǔ)言實(shí)現(xiàn)，在ISE下創(chuàng)建的工程。

功能如下：

本設(shè)計(jì)中輸入為上下左右4個(gè)按鍵，輸出有數(shù)碼管和LED燈。

通過(guò)對(duì)上下左右的按鍵正確，數(shù)碼管和LED燈有相應(yīng)的顯示。

下面是在ISE下的工程截圖：

Initial：                                     //程序初始化

lw r3,0(r0);                                  //r3=F0000000,數(shù)據(jù)存儲(chǔ)器預(yù)設(shè)

lw r20,c(r0)                               //r20=54,用于最后判斷勝利的指令數(shù)目，

                                          即ram中最后一個(gè)表示方向的data位置

總結(jié)

以上是生活随笔為你收集整理的基于FPGA的跳舞机实现的全部?jī)?nèi)容，希望文章能夠幫你解決所遇到的問(wèn)題。

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